Die Einschalten von Bedingungen für aP-Kanal-MOSFET (PMOS)sind invers zu denen eines N-Kanal-MOSFET (NMOS), das hauptsächlich durch die Beziehung zwischen der Gate-Source-Spannung (VGS) und der Schwellenspannung (VTH) zusammen mit der Spannungspolarität bestimmt wird. Hier sind die wichtigsten Punkte:
1. Kernverstärkungsbedingungen
Die notwendige Bedingung für ein PMOS ist: v: vGs≤ VTH (wobei VTH negativ ist)
VGs= VG–VS(VG= Gatespannung, vS= Quellspannung).
Seit vthFür PMOS ist typischerweise negativ (z. B. -1V, -2 V), die Gate -Spannung muss seinsignifikant niedrigerals die Quellspannung, um v zu erfüllenGs≤Vth.
Beispiel:
Wenn vth= –2 V und vS=+5v, dann: vG–5 V ≤ - 2V⟹vG≤+3V
Die PMOs schalten sich an, wenn vGTropfen unter 3V.
2. Vergleich mit N-KanalMOSFET (NMOS)
Merkmal | P-Kanal-MOSFET (PMOS) | N-Kanal-MOSFET (NMOS) |
---|---|---|
Schaltbedingung | VGS ≤ VTH (VTH Negativ) | VGS ≥ VTH (VTH Positiv) |
Spannungspolarität | Gatespannung muss seinuntereals Quelle | Gatespannung muss seinhöherals Quelle |
Typische Anwendung | High-Side-Switches (Quelle wird mit V+verbunden) | Niedrige Schalter (Quelle wird mit GND verbunden) |
Körperdiodenrichtung | Quelle (s) → Drain (d) | Abfluss (d) → Quelle (en) |
3.. Wichtige praktische Überlegungen
Hochseitiger Umschalten:
PMOSwird üblicherweise in hochseitigen Schaltschaltkreisen verwendet (Quelle, die mit der Stromversorgung verbunden sind, auf die Last abtropfen). Eine niedrige Torspannung schaltet sie ein und erden Sie die Last. Beispiel:In batteriebetriebenen Schaltungen steuert PMOS die Stromversorgung der Last und vereinfacht die Steuerung der Logikebene.
Spannungspolarität und Antriebskreis:
PMOS benötigt aPulldown-Treiber(z. B. ein NPN -Transistor oder NMOs), um die Gate -Spannung unter der Quelle zu senken.
In der CMOS -Logik (z. B. Wechselrichter) zieht PMOs den Ausgang hoch und ergänzt NMOs, das niedrig zieht.
Körperdiodeneffekte:
PMOS hat eine innere Körperdiode von Quelle zum Abfluss. Wenn die Abflussspannung die Quellspannung überschreitet, leitet die Diode möglicherweise einen unbeabsichtigten Stromfluss.Designer müssen umgekehrte Spannungen vermeiden oder Schutzmaßnahmen hinzufügen.
4. Zusammenfassung
PMOS leitet ⟺VG<VS+∣vth∣ (wo vthist negativ)
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